웨비나
SoCFPGA를 이용한 알고리즘 가속(소프트웨어 엔지니어들을 위한)
김민호2014-05-20T10:53:51.000Z
알테라 툴에서 OpenOCD 디버거는 지원하지 않나요?2014-05-20T11:00:07.000Z
확인 후 연락드리겠습니다. jeffjeong@axios.co.kr으로 문의 부탁드립니다.정대식2014-05-20T10:53:44.000Z
ARM의 표준 인터페이스로 디자인된 인터페이스를 Qsys를 이용해 SoCFPGA에 구현 가능한가요?2014-05-20T10:58:45.000Z
AMBA protocol을 Qsys에서 지원하기에 가능합니다.안경수2014-05-20T10:53:34.000Z
ARM과 FPGA를 따로 따로 동시에 접근이 가능한가요? 두명의 엔지니어가 각각 동시에 디버깅이 가능한지 궁금합니다.2014-05-20T10:58:05.000Z
네 만약 JTAG회로를 별도로 구성하시면 가능합니다.이천용2014-05-20T10:53:12.000Z
툴 아답터는 jtag 구성에 따라 별도로 사용해아 하나요2014-05-20T10:57:34.000Z
SoC FPGA는 하나의 JTAG header(하나의 JTAG debugger)로 CPU와 FPGA가 동시에 디버깅 가능하므로 별도로 구성하실 필요없습니다.이천용2014-05-20T10:52:38.000Z
one 디바이스와 two 디바이스 툴은 공용으로 사용하는지요2014-05-20T12:06:36.000Z
메일을 통해 답변해 드리겠습니다. 감사합니다. ^^이천용2014-05-20T10:51:35.000Z
fpga 디버깅용 툴 구성은 어느 아킥텍처로 구성되어 있는지요2014-05-20T10:56:29.000Z
기존의 Altera USB blaster를 그대로 사용한다고 생각하시면 됩니다.김영빈2014-05-20T10:50:56.000Z
fpga와 arm 디버깅은 개별적으로 가능한가요? 디버깅 포트 측면에서..2014-05-20T10:55:52.000Z
네 가능합니다.이천용2014-05-20T10:50:51.000Z
fpga 와 소프트웨어 디자인 플로워 차이점이 뭐지요2014-05-20T12:06:30.000Z
메일을 통해 답변해 드리겠습니다. 감사합니다. ^^김영빈2014-05-20T10:49:56.000Z
Realtime 처리가 가능한가요? 평가 방법은 어떻게 하나요?2014-05-20T10:55:33.000Z
질의하신 내용에 대해 정확하게 이해를 못했습니다. jeffjeong@axios.co.kr으로 문의주시면 답신 드리겠습니다.김민호2014-05-20T10:49:47.000Z
그게 아니라 디바이스에서 DMA 를 사용하여 L2 캐시에 직접저장하는 통로를 제공한다고 하셨는데 구성도보니 L2 캐시는 FPGA 와 ARM 이 공유하는 구조인데 그경우 ARM/FPGA 는 L2 캐시 액세스 못하고 대기하는 거아닌가 해서 질문드린 겁니다.2014-05-20T10:52:41.000Z
네, 말씀하신바와 같이 미시적으로 보면 대기상태로 갈수 있습니다.